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MD653D不是個繞城高速度12五位數模轉變成器（DAC），集為48:12（12管道4:1）設置多路復接器。片上DAC也可以以高達獨角獸4.5gsps的抽樣率辦公。DAC的仿真輸送可在正常情況始終保持模型（用以最奈奎斯特光波）或復位模型（用以最、二是和3奈奎斯特光波）中間采用。差高考平均分行數據文件顯示設置數據文件顯示接口與LVPECL、LVDS和CML兼容。在48對差高考平均分據設置被多路復接到4倍的速率后，1兩個繞城高速度數據文件顯示位被鎖存并打碼以驅使DAC輸送級。相輔相成輸送可與50Ω輸送后面用戶。提高剩以4的鬧鐘輸送和抽樣相位采用（SEL1和SEL2），以優化相對的于設置數據文件顯示的抽樣相位的位置合適。還提高了剩以8的鬧鐘輸送。我們對所需同時進行多種MD653D輸送的操作系統應該用環節，提高了更改職能。

一般基本特征?DAC每個填寫位的4:1復接率?12位辯別率DAC將高達4.5 Gsps濃度?DAC模擬系統打出格局可在順利始終維持（NH）機制或清零（RZ）機制內選購?帶50Ω反面終端互補式打印輸出?為的數據同樣展示 互補式的除4和除8鬧鐘工作輸出?2.8 W工作電壓?可調400~800 mVPP單端所在擺幅?沒個差分填寫數據顯示和初始化對之間的IC芯片上100歐姆終端用戶?LQFP包，帶顯露墊